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   * En la figura adjunta se ve el arbitraje entre dos master, aunque pueden estar involucrados más. En el momento en que hay una diferencia entre el nivel interno de la línea de datos del master ''DATA1'' y el actual nivel de la línea de datos ''SDA'', su salida de datos es interrumpida, lo cual significa que un nivel ''0'' esta dominando en el Bus. Esto no afecta los datos transferidos inicialmente por el master ganador.   * En la figura adjunta se ve el arbitraje entre dos master, aunque pueden estar involucrados más. En el momento en que hay una diferencia entre el nivel interno de la línea de datos del master ''DATA1'' y el actual nivel de la línea de datos ''SDA'', su salida de datos es interrumpida, lo cual significa que un nivel ''0'' esta dominando en el Bus. Esto no afecta los datos transferidos inicialmente por el master ganador.
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   * En el momento que un master toma el control, solo este master toma las decisiones y genera los códigos de dirección, no existen master centrales, ni existen órdenes prioritarias en el bus.   * En el momento que un master toma el control, solo este master toma las decisiones y genera los códigos de dirección, no existen master centrales, ni existen órdenes prioritarias en el bus.
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  • doc/tec/lab/bus_i2c/0_arbitraje/inicio.txt
  • Última modificación: 2026/03/28 18:37
  • por fepg