Diferencias
Muestra las diferencias entre dos versiones de la página.
| Ambos lados, revisión anterior Revisión previa | |||
| doc:tec:lab:bus_i2c:0_arbitraje:inicio [2026/03/28 18:34] – ↷ Página movida de edu:all:lab:i2c:0_arbitraje:inicio a doc:tec:lab:bus_i2c:0_arbitraje:inicio fepg | doc:tec:lab:bus_i2c:0_arbitraje:inicio [2026/03/28 18:37] (actual) – ↷ Enlaces adaptados debido a una operación de mover fepg | ||
|---|---|---|---|
| Línea 17: | Línea 17: | ||
| * En la figura adjunta se ve el arbitraje entre dos master, aunque pueden estar involucrados más. En el momento en que hay una diferencia entre el nivel interno de la línea de datos del master '' | * En la figura adjunta se ve el arbitraje entre dos master, aunque pueden estar involucrados más. En el momento en que hay una diferencia entre el nivel interno de la línea de datos del master '' | ||
| \\ | \\ | ||
| - | {{ edu:all:lab:i2c: | + | {{ doc:tec:lab:bus_i2c: |
| \\ | \\ | ||
| * En el momento que un master toma el control, solo este master toma las decisiones y genera los códigos de dirección, no existen master centrales, ni existen órdenes prioritarias en el bus. | * En el momento que un master toma el control, solo este master toma las decisiones y genera los códigos de dirección, no existen master centrales, ni existen órdenes prioritarias en el bus. | ||
| \\ | \\ | ||